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synced 2026-06-08 03:40:35 +09:00
rk312x:clk:modify the vio clk dependencies
This commit is contained in:
@@ -155,6 +155,33 @@
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#clock-cells = <0>;
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};
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hclk_vio_niu: hclk_vio_niu {
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compatible = "rockchip,rk-fixed-factor-clock";
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clocks = <&hclk_vio_pre>;
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clock-output-names = "hclk_vio_niu";
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clock-div = <1>;
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clock-mult = <1>;
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#clock-cells = <0>;
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};
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aclk_vio0_niu: aclk_vio0_niu {
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compatible = "rockchip,rk-fixed-factor-clock";
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clocks = <&aclk_vio0_pre>;
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||||
clock-output-names = "aclk_vio0_niu";
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||||
clock-div = <1>;
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clock-mult = <1>;
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#clock-cells = <0>;
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||||
};
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||||
aclk_vio1_niu: aclk_vio1_niu {
|
||||
compatible = "rockchip,rk-fixed-factor-clock";
|
||||
clocks = <&aclk_vio1_pre>;
|
||||
clock-output-names = "aclk_vio1_niu";
|
||||
clock-div = <1>;
|
||||
clock-mult = <1>;
|
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#clock-cells = <0>;
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||||
};
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};
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pd_cons {
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@@ -1719,14 +1746,14 @@
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compatible = "rockchip,rk3188-gate-clk";
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reg = <0x00e8 0x4>;
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clocks =
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<&aclk_vio0_pre>, <&hclk_vio_pre>,
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<&aclk_vio0_niu>, <&hclk_vio_niu>,
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<&dummy>, <&dummy>,
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<&hclk_vio_pre>, <&aclk_vio0_pre>,
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<&hclk_vio_niu>, <&aclk_vio0_niu>,
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<&dummy>, <&dummy>,
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<&dummy>, <&dummy>,
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<&hclk_vio_pre>, <&aclk_vio0_pre>,
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<&hclk_vio_niu>, <&aclk_vio0_niu>,
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<&hclk_vio_pre>, <&aclk_vio0_pre>,
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<&dummy>, <&dummy>;
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@@ -1741,7 +1768,7 @@
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"reserved", "reserved",
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"g_hclk_rga", "g_aclk_rga",
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"g_hclk_vio_bus", "g_aclk_vio",
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"hclk_vio_niu", "aclk_vio0_niu",
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"reserved", "reserved";
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rockchip,suspend-clkgating-setting = <0x0000 0x0000>;
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@@ -1823,10 +1850,10 @@
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<&dummy>, <&dummy>,
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<&pclk_pmu_pre>, <&pclk_pmu_pre>,
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<&dummy>, <&hclk_vio_pre>,
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<&hclk_vio_pre>, <&hclk_vio_pre>,
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<&dummy>, <&hclk_vio_niu>,
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<&hclk_vio_niu>, <&hclk_vio_niu>,
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<&aclk_vio1_pre>, <&hclk_vio_pre>,
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<&aclk_vio1_niu>, <&hclk_vio_niu>,
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<&aclk_vio1_pre>, <&dummy>,
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<&pclk_peri_pre>, <&hclk_peri_pre>,
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@@ -1840,7 +1867,7 @@
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"g_pclk_mipi", "g_hclk_iep",
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"g_aclk_iep", "g_hclk_ebc",
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"g_aclk_vio1_niu", "reserved",
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"aclk_vio1_niu", "reserved",
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"g_pclk_sim_card", "g_hclk_usb_peri",
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"g_hclk_pe_arbi", "g_aclk_peri_niu";
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@@ -386,15 +386,15 @@
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<&clk_gates4 1>,/*pclk_peri_axi_matrix*/
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/*hclk_vio_pre*/
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<&clk_gates6 12>,/*hclk_vio_niu*/
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//<&clk_gates6 12>,/*hclk_vio_niu*/
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//<&clk_gates6 1>,/*hclk_lcdc*/
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/*aclk_vio0_pre*/
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<&clk_gates6 13>,/*aclk_vio*/
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//<&clk_gates6 13>,/*aclk_vio*/
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//<&clk_gates6 0>,/*aclk_lcdc*/
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/*aclk_vio1_pre*/
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<&clk_gates9 10>,/*aclk_vio1_niu*/
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//<&clk_gates9 10>,/*aclk_vio1_niu*/
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/*UART*/
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<&clk_gates1 12>,
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