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synced 2026-06-07 19:30:30 +09:00
ARM: rockchip: rk3036 add cpu axi bus support
This commit is contained in:
@@ -50,6 +50,51 @@
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<GIC_SPI 77 IRQ_TYPE_LEVEL_HIGH>;
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};
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cpu_axi_bus: cpu_axi_bus {
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compatible = "rockchip,cpu_axi_bus";
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#address-cells = <1>;
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#size-cells = <1>;
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ranges;
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qos {
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#address-cells = <1>;
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#size-cells = <1>;
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ranges;
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core {
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reg = <0x1012a000 0x20>;
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rockchip,priority = <3 2>;
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};
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peri {
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reg = <0x1012c000 0x20>;
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};
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gpu {
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reg = <0x1012d000 0x20>;
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};
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vpu {
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reg = <0x1012e000 0x20>;
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};
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hevc {
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reg = <0x1012e080 0x20>;
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};
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vio {
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reg = <0x1012f000 0x20>;
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rockchip,priority = <3 3>;
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};
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};
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msch {
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#address-cells = <1>;
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#size-cells = <1>;
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ranges;
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msch@10128000 {
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reg = <0x10128000 0x40>;
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rockchip,read-latency = <0x80>;
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};
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};
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};
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sram: sram@10080000 {
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compatible = "mmio-sram";
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reg = <0x10080000 0x2000>;
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@@ -12,7 +12,8 @@
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#define CPU_AXI_QOS_MODE_LIMITER 2
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#define CPU_AXI_QOS_MODE_REGULATOR 3
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#define CPU_AXI_QOS_PRIORITY_LEVEL(h, l) ((((h) & 3) << 2) | ((l) & 3))
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#define CPU_AXI_QOS_PRIORITY_LEVEL(h, l) \
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((((h) & 3) << 8) | (((h) & 3) << 2) | ((l) & 3))
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#define CPU_AXI_SET_QOS_PRIORITY(h, l, base) \
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writel_relaxed(CPU_AXI_QOS_PRIORITY_LEVEL(h, l), base + CPU_AXI_QOS_PRIORITY)
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